蕪湖市 Philips PM8927A 特惠供應 返回列表頁

3.3 FPGA邏輯設計

　　FPGA是整個系統的核心，它需要產生測試數據并將數據存儲到DDR2中，以及將DDR2中讀出的數據轉移到CYUSB3014大的內部FIFO中，因此它主要由如圖2內部所示模塊構成。

　　3.3.1 Philips PM8927A接口模塊

Philips PM8927A 接口模塊主要處理讀寫命令。讀寫命令需要計算機通過USB控制傳輸，傳遞到CYUSB3014中，再由CYUSB3014將具體的命令轉化為電平信號送到FPGA的IO口。USB接口模塊根據UART_RX上的電平信號，判斷出是讀命令還是寫命令，zui終產生CYUSB3014的片選CS、使能 OE、讀/寫控制等有效信號。

　　當為寫命令時，Philips PM8927A需要將從DDR2中讀取的數據發送出去;當為讀命令，讀取CYUSB3014傳遞過來的數據，流程圖如圖4所示。圖5、圖6分別為同步寫入和讀出數據的時序圖。由于讀寫zui大包為1024字節，所以實際每一包傳輸需要256個周期。圖中的輸入/出DQ數據為測試數據模塊和PC機產生的測試數據，RX即UART_RX信號。

　　3.3.2 Philips PM8927A測試數據模塊

　　當計算機向FPGA發出讀命令時，FPGA產生測試數據。32位數據，高16位為0，低16位循環計數，發送一個周期后，自動清零。

　　批量（bulk）傳輸時的zui大包大小為1024字節，因此測試數據在0~255之間循環變化。

　　產生測試數據后，數據傳輸流程為DATA->

　　DDR2->FIFO->CYUSB3014->PC機，實現了將測試數據上傳到PC機的功能。

　　3.3.3 Philips PM8927A接口模塊

　　該部分直接負責外圍DDR2接口，利用FPGA的DDRII SDRAM IP核實現，按照DDR2芯片MT47H64M16HR來設定控制器的時序參數，控制器根據這些參數值生成滿足MT47H64M16HR時序的接口，再由DDR2模塊進行讀寫控制。

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