2711-M3A19L1/A * 返回列表頁

2711-M3A19L1/A與MT對處理器性能的提升著程度上的不同。 但是會造成這樣的結果，其實2家IP廠商的研發概念上有很大的關連。由于MT技術著重于處理單元、內存控制器的有效利用，在zui大程度上節省晶體管的使用，并且在此前提之下往上提升效能表現，這與MP架構中，系統效能需求有多少，就復制多少個核心塞進芯片中的浪費作法*不同，MP可以取得較為全面的應用廣度，但是稍嫌鋪張浪費，相較之下，MT在成本與效能方面的平衡性表現要來得高明些。

許多人將MP與MT相提并論，而在某種程度上，這樣的比較其實并沒有太大意義，因為基本設計概念已經天差地遠，架構上的采用自然無法一概而論。在技術上，為了實現硬件多重處理，兩者對于軟件*化的復雜度方面其實都同樣比單核心架構要來得復雜許多，而為了要盡量避免處理單元與內存控制器在資源分配上的沖突，MT架構或許會來得更為復雜一些，但MP 架構其實在某些程度上也會面臨同樣的問題（特別是共享高速緩存與內存控制器的多核心架構）。

不論是在指令層級，或是執行緒層級的多任務，都與2711-M3A19L1/A傳統單核心單執行緒的程序寫作方式與*化方法大異其趣。 一般的MT架構設計方面，單一處理器核心在運算的過程中，常會有內存存取速度跟不上處理器頻率增加的問題，進而導致高速緩存錯失（miss）時，形成執行管線長時間閑置的狀況，我們都了解，1個2711-M3A19L1/A系統中的儲存單元，zui快速的要屬處理器中的緩存器，其次是L1高速緩存、L2快取記體，zui后則是主存儲器，其速度的差別可達數千倍以上，處理器要取得指令或數據時，必先從高速緩存中提取，儲存于緩存器中進行運算，zui終結果再回存到高速緩存，并在空閑時填回主存儲器，當2711-M3A19L1/A處理器向高速緩存發出存取需求，卻發現所需要的數據不在高速緩存中，這是就必須花費大筆的時間前往主存儲器尋找并讀取，這其間所浪費的時間可能會高達數十個頻率周期，處理管線在等待數據*的時間，就形成了閑置狀態。 

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