KSD1-64 KUKA 江蘇省* 返回列表頁

KSD1-64圖像處理系統結構 本系統采用TI公司C6000系列DSP中的TMS320C6211作為系統的CPU。圖像數據通過視頻頭輸入模擬圖像信號，這些信號經過視頻解碼芯片進行A/D轉換為數字信號，經FIFO輸入DSP進行圖像的增強、分割、特征提取和數據壓縮等，然后輸出信號經PCI解碼芯片轉換為符合PCI總線規范的標準信號，通過PCI總線接口傳到上位機。 KSD1-64本系統設計目的是用于智能樓宇的管理，主要實現對樓宇一些重要參數的實時檢測功能等。當然可以用于其他的監控系統，其硬件系統基本*，不同的在于軟件功能的區別。系統結構圖如圖1。

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從圖1可以看出，整個系統可分為3個模塊: KSD1-64圖像處理模塊，視頻解碼模塊，PCI總線模塊。下面分別介紹這3個模塊的實現過程和功能。 2.1 DSP圖像處理模塊 本系統選用TI公司的C6000系列DSP之中的TMS320C611作為本系統的CPU。C6000是TI公司發布的面向視頻處理領域的新款高速數字處理芯片，適用于移動通信基站、圖像監控、雷達系統等需要高速度和高度智能化的應用領域。存儲空間選用現代公司的2片HY57V651620B作為運行過程中的存儲器（SDRAM）和AMD公司的AM29LV800B 作為啟動時候需加載程序和參數的存儲器（FLASH）。其結構如圖2所示。圖中的HPI（Host Port Interface）為主機口;EMIF（External Memory Interface）為外部存儲器接口，兼容同步/異步方式。

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（1） KSD1-64處理器特性及完成功能 TMS320C6211處理器由3個主要部分組成:CPU內核、外設和存儲器。它的高速性能主要體現在如下幾個方面:① TMS320C6211的存儲空間zui大擴展可以達到512MB，這*可以滿足各種圖像處理系統所需的內存空間，而且其zui高時鐘可達167MHz，峰值性能可達1600MIPS（百萬條指令/秒）、2400MOPS（百萬次操作/秒）。

② 并行處理結構。KSD1-64芯片內有8個并行處理單元，分為相同的兩組，并行結構突破傳統設計使得芯片具有很高的性能。

③ 芯片體系采用VelociTI結構。VelociTI是一種高性能的甚長指令字（VLIW）結構，單指令字字長為32bit，8個指令組成一個指令包，總字長為256bit，即每秒鐘可以執行8條指令，同時芯片內部設置了專門的指令分配模塊，可以將每個256bits的指令包同時分配到8個處理單元，并由8個單元同時執行。

④ 采用流水線操作實現高速度、高效率。KSD1-64只有在流水線充分發揮作用的情況下，才能達到zui高的MIPS。C6211的流水線分為3個階段:指令讀入、解碼和執行，總共11級。

KSD1-64完成的功能主要是對從FIFO讀入的數據進行處理，包括依照程序進行識別、特征提取以參數檢測等。當視頻頭采集速度為每秒25幀圖像時，它留給DSP處理的時間zui多為每幀40ms，如果考慮系統中一定的延時以及處理后圖像的存儲時間，那么DSP處理一幅圖像時間不能超過30ms，按照C6211的處理速度，在30ms內可以處理36M條指令。

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