A-B 1756-OB16I 好價格零貨期 1756-OB16I 返回列表頁

A-B 1756-OB16I 在元器件的布局方面，應該把相互有關的元件盡量放得靠近一些，例如，時鐘發生器、晶振、CPU的時鐘輸入端都易產生噪聲，在放置的時候應把它們靠近些。對于那些易產生噪聲的器件、小電流電路、大電流電路開關電路等，應盡量使其遠離單片機的邏輯控制電路和存儲電路（ROM、RAM），如果可能的話，可以將這些電路另外制成電路板，這樣有利于抗干擾，提高電路工作的可靠性。

　　（2） 盡量在關鍵元件，如A-B 1756-OB16I等芯片旁邊安裝去耦電容。實際上，印制電路板走線、引腳連線和接線等都可能含有較大的電感效應。大的電感可能會在Vcc 走線上引起嚴重的開關噪聲尖峰。防止Vcc走線上開關噪聲尖峰的*方法，是在VCC與電源地之間安放一個0.1uF的電子去耦電容。如果電路板上使用的是表面貼裝元件，可以用片狀電容直接緊靠著元件，在Vcc引腳上固定。是使用瓷片電容，這是因為這種電容具有較低的靜電損耗（ESL）和高頻阻抗，另外這種電容溫度和時間上的介質穩定性也很不錯。盡量不要使用鉭電容，因為在高頻下它的阻抗較高。

　　A-B 1756-OB16I在安放去耦電容時需要注意以下幾點：

　　·在印制電路板的電源輸入端跨接100uF左右的電解電容，如果體積允許的話，電容量大一些則更好。

　　·原則上每個集成電路芯片的旁邊都需要放置一個0.01uF的瓷片電容，如果電路板的空隙太小而放置不下時，可以每10個芯片左右放置一個1～10的鉭電容。

　　· 對于抗*力弱、關斷時電流變化大的元件和RAM、ROM等存儲元件，應該在電源線（Vcc）和地線之間接入去耦電容。

　　·電容的引線不要太長，特別是高頻旁路電容不能帶引線。

　　（3） 在單片機控制系統中，地線的種類有很多，有系統地、屏蔽地、邏輯地、模擬地等，地線是否布局合理，將決定電路板的抗*力。在設計地線和接地點的時候，應該考慮以下問題：

　　·邏輯地和模擬地要分開布線，不能合用，將它們各自的地線分別與相應的電源地線相連。在設計時，模擬地線應盡量加粗，而且盡量加大引出端的接地面積。一般來講，對于輸入輸出的模擬信號，與單片機電路之間通過光耦進行隔離。

　　·A-B 1756-OB16I在設計邏輯電路的印制電路版時，其地線應構成閉環形式，提高電路的抗*力。

　　·地線應盡量的粗。如果地線很細的話，則地線電阻將會較大，造成接地電位隨電流的變化而變化，致使信號電平不穩，導致電路的抗*力下降。在布線空間允許的情況下，要保證主要地線的寬度至少在2～3mm以上，元件引腳上的接地線應該在1.5mm左右。

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